电子科大11春学期《EDA技术》在线作业三

久爱奥鹏晓林

一、单选题（共 20 道试题，共 100 分。）V 1.  国际上生产FPGA/CPLD的三家主流公司为
A. Altera、Xilinx、Lattice公司
B. Altera、Marax、Lattice公司
C. IBM、Xilinx、Lattice公司
D. Altera、Xilinx、AD公司
      满分：5  分
2.  VHDL程序基本结构包括
A. 实体、子程序、配置
B. 实体、结构体、配置、函数
C. 结构体、状态机、程序包和库
D. 实体、结构体、程序包和库
      满分：5  分
3.  MAX+PLUS的文本文件类型是（后缀名）是
A. *.scf
B. *.vhd
C. *.gdf
D. *.sof
      满分：5  分
4.  在VHDL中，用语句_____表示clock的下降沿
A. clock’EVENT
B. clock’EVENT  AND  clock=’1’
C. clock=’0’
D. clock’EVENT  AND  clock=’0’
      满分：5  分
5.  VHDL的描述风格有
A. 行为描述、数据流描述和结构描述
B. 行为描述、门级描述和数据流描述
C. 数据流描述、结构描述和版图描述
D. 门级描述、结构描述和版图描述
      满分：5  分
6.  在VHDL语言中，下列对时钟边沿检测描述中，错误的是
A. if clk’event and clk = ‘1’ then
B. if falling_edge(clk) then
C. if clk’event and clk = ‘0’ then
D. if clk’stable and not clk = ‘1’ then
      满分：5  分
7.  字符串型文字O“1234”的长度为___________。
A. 12
B. 4
C. 8
D. 16
      满分：5  分
8.  在元件例化语句中，用_______符号实现名称映射，将例化元件端口声明语句中的信号与PORT MAP（）中的信号名关联起来。
A. =
B. :=
C. <=
D. =>
      满分：5  分
9.  变量是一种局部量，变量可在以下哪些位置进行定义
A. process、architecture、entity
B. process、function、procedure
C. function、entity、package
D. entity、package、procedure
      满分：5  分
10.  关于数组A的定义如下：signal A：bit_vector(7 downto 0);那么，A=“00110101”，A(6 downto 5)＝_____________。
A. ’00
B. 10
C. ‘01
D. 11
      满分：5  分
11.  进程语句的启动条件是
A. wait语句或敏感信号量
B. wait语句
C. 敏感信号量
D. wait语句或且敏感信号量
      满分：5  分
12.  值为“1110”的标准逻辑矢量，进行sla运算后值为____________ 。
A. 1100
B. 1101
C. 1110
D. 1000
      满分：5  分
13.  下列关于信号的说法正确的是
A. 信号是一个局部量，它只能在进程和子程序中使用。
B. 信号的赋值不是立即发生的。
C. 在进程的敏感信号表中，既可以使用信号，也可以使用变量。
D. 信号赋值的一般表达式为：目标信号名：= 表达式。
      满分：5  分
14.  一个完整结构的结构体由哪两个基本层次组出
A. 数据说明和进程
B. 结构体说明和结构体功能描述
C. 顺序描述语句和并行执行语句
D. 结构体例化和结构体赋值
      满分：5  分
15.  下面哪个标识符是符合VHDL语法的合法标识符
A. 4plus
B. v-4
C. the_signal
D. buffer
      满分：5  分
16.  VHDL的语言要素包括以下几类
A. 数据对象、数据类型、操作数、操作符
B. 数据对象、结构体、操作数、操作符
C. 实体、数据类型、操作数、操作符
D. 数据对象、配置、操作数、重载操作符
      满分：5  分
17.  下面哪个说法是错误的
A. 进程语句与进程语句之间是并行执行的，进程语句内部是顺序执行的
B. 进程语句是可以嵌套使用的
C. 块语句与块语句之间是并行执行的，块语句内部也是并行执行的
D. 块语句是可以嵌套使用的
      满分：5  分
18.  下列关于元件例化语句的说法正确的是
A. 位置关联方式与顺序有关，名称关联方式与顺序有关。
B. 位置关联方式与顺序有关，名称关联方式与顺序无关。
C. 位置关联方式与顺序无关，名称关联方式与顺序有关。
D. 位置关联方式与顺序无关，名称关联方式与顺序无关。
      满分：5  分
19.  请在下例的语句中选择所需的符号____。signal a,b,c : std_logic;c____a＋b after 10ns;
A. :＝
B. <＝
C. ＝＝
D. ＝
      满分：5  分
20.  下面哪个标识符是符合VHDL语法的合法标识符
A. constant
B. 2fft
C. _decoder_1
D. sig_n
      满分：5  分
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