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东北大学12春学期《数字信号处理器原理及应用》在线作业2

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发表于 2012-4-2 10:10:04 | 显示全部楼层 |阅读模式
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, a4 K7 k* d) }/ T$ ]& N' h- M' E- K- Q, }4 i
一、单选(共 10 道试题,共 50 分。)V 1.  当XPLLDIS为     时,系统直接采用外部时钟或外部晶振直接作为系统时钟. k1 Y9 f8 K1 W
A. 高电平4 p/ k! I' W. v/ z% A- w
B.  低电平
. t# h5 s. P: e. a, l1 mC. 高阻
- v" o& @% q  j' D; }D.  悬空% R3 f; |* K3 A( B4 T/ H
      满分:5  分
0 |+ D3 E$ ~) k: ]# U/ ?( K2.  看门狗可以提高系统的     
6 l. p/ q4 Q/ _+ Z* WA. 效率2 ?) N' Y/ |3 i1 y
B. 成本
( H) @( l6 i9 |C. 可靠性. x- w7 b# s/ l0 B4 z5 O
D. 频率$ Y" s$ p8 n' T$ Q
      满分:5  分; B/ t0 a9 T4 }2 T4 Y$ [
3.  看门狗的逻辑校验位WDCHK必须是   才可以正确访问WDCR寄存器 8 U( c. x: g8 l2 ?8 T- j
A. 0100 D* ]9 k1 n* c) q
B. 101
, H! y" T& R6 }& A  yC. 001* K) O- l+ M! ^5 X8 P
D. 100
, _' X' M6 E5 P      满分:5  分% {" V. v: \& a+ v9 F2 C) h
4.  F2810/F2812器件有      个32位 CPU定时器9 a# z* m3 ~. ?
A. 3
" l9 z! ^; Y; K/ b3 C5 t* V/ ^& FB. 25 A- S: A4 ]  p, C' j, D! ]$ b
C. 1
! T. x& S" L, ^1 I: F+ R( }; aD. 0) i  c% T4 c5 F' \
      满分:5  分
: t7 E) u' N! D/ _  q8 }" l5.  TMS320F2812 处理器的片上晶振和锁相环模块为内核及外设提供      ; Q/ F$ k" W# Y+ s% \
A. 时钟信号6 d. `) N* a* g4 J' U' D% {
B.   数字信号8 u' R0 z( m1 ]. W1 F
C. 中断信号- {' p# [) o( g6 P- o) j7 @& Z+ `8 r' x
D. 通信信号7 S; o8 p9 m9 n/ l4 R  l- B, m
      满分:5  分
) j9 U# B$ ]7 U% P* F) F$ T, X+ @6.  下列数据写入WDKEY不会使系统复位的是
0 Y8 |. f: N- `. U# iA. 0x55和0xAA) }5 P) o  W- z* p) p
B. 0x00和0xFF
7 d; Y) J* W9 S! J8 B: k$ O+ vC. 0x77和0xBB8 b* D# U6 F, ?
D. 0x33和0xCC/ Z# y  w# c$ h. Q
      满分:5  分
' r, S& a) w0 U2 e2 |. g7.  WDPS是看门狗    控制的
4 [/ R' O( D6 O2 z5 iA. 标志位7 @3 E  P5 _: P3 I+ R1 J0 Y
B. 禁止! v+ k( t2 m: j* d' p; b) W( S9 |
C. 校验
* w: r2 d2 s3 I- m8 I4 B; M: _D.   预定标4 H. V& O. ]+ z& d4 v
      满分:5  分0 H/ V* Y! Y4 l" C( l+ X
8.  此C281x CPU除了支持      个CPU级的中断外
$ H+ U  X2 e9 C2 rA. 64! Q8 V: s* |, V$ Y: F$ e
B. 16
- I- j# g7 M1 DC. 32) f  f" l6 d  H- ~5 b
D. 8
' A" b) u  S) P# [  A; n      满分:5  分
6 F) s; m' S& y# r" C9.  看门狗计数器最大计数值是    9 o/ r# m6 d9 r" c2 H8 w
A. 256% T, C8 V! O/ g( P6 O, \
B. 254
( z( L' f* e# @9 eC. 255# d# [$ H9 _7 D  ], e. s
D. 2578 ]& {0 @" p$ n! Y% ?* j/ f
      满分:5  分
$ K6 Q1 ^: k' Y, T10.      作为全局中断使能控制位( R# p: ]. \7 b9 X+ I# G, {
A. 8 q8 J: ]$ G% J7 h5 j/ i
PIE8 |% _1 R) m7 b; v7 }

% D% s. A$ T# u2 |8 q3 gB. IER) C& N+ u) K3 M+ g6 V6 G! H2 R6 Q% E
C. INTM
+ g: V/ J. f( |' J7 v1 Z5 F/ XD. IFR
9 i$ \1 v) O/ `+ b      满分:5  分 # [* E3 b4 t+ V$ C
2 R- R8 V# L9 E. e7 a; N
二、判断题(共 10 道试题,共 50 分。)V 1.  4 l: W! g1 u6 E) t9 b' T! Y7 G; o& C
改变标志寄存器的状态,不会清除某些有用的中断信息或者产生意外中断。
" m% m; A- J; R
: q1 D, _9 }; TA. 错误" }; b- w, }+ S9 t4 g
B. 正确* d1 L5 e, U8 M! y
      满分:5  分7 I- Z  h* P" W2 x: r1 a, V1 V
2.  
) Z% Q! i; C  [# }中断使能寄存器的16 位分别控制每个中断的使能状态,当相应的位置1 时使能中断,写0 禁止中断。
0 U) u( ^" G" E: a! S4 ?. k' ]! d& `5 U2 w6 N  v$ N
A. 错误$ C; v4 K3 m9 G  b  |
B. 正确
3 W2 b" `* a; M) p3 g# p- l5 @8 ?; A      满分:5  分
4 ~$ _) W9 _9 d; c5 v/ o/ z3.  
0 a9 T$ r; ?" d! B. N* \外设产生中断时,中断标志寄存器(IF)相应的位将被置0,如果中断使能寄存器(IE)中相应的使能位也被清零,则外设产生的中断将向PIE控制器发出中断申请。
" u  _& e% f" }) P& k- [- {7 U& f* Y& t: ]) [0 l1 D) i
A. 错误
8 V2 Y) c2 p. F  Q' VB. 正确
! j/ ~, {0 K3 |: g" Q: s: S) [8 E      满分:5  分: I: F$ x: V& \/ S' E* X8 B7 M- x5 d6 o
4.  
6 j0 u- m, E% H" e5 f, [具有输入量化功能的引脚,用户可以定义量化时间长度以便消除不必要的干扰信号。3 R! O- K0 `& o- V" b. F
# P0 [# b" Q# N0 z0 Q4 j
A. 错误
# \) `/ q2 b8 g* B/ a/ M4 YB. 正确8 w' y0 k- Y5 k9 P; }8 w
      满分:5  分
6 w: A: n# y4 E! h& b! u# @5.  " ^  y! N' T: `
GPX_MUX寄存器用来选择281x处理器多功能复用引脚的操作模式,各引脚可以独立的配置在GPIO模式或者是外设专用功能模式。9 C9 X9 a# y# \# \5 y

0 i$ E$ W% ~+ o4 f) y! d: D' _A. 错误
& F' d( T- s- TB. 正确
' K4 S' v6 J, e; s6 l3 Z      满分:5  分
! W4 C* o8 q* n% ~, C6.  ; s& T9 g' d+ l
  可屏蔽中断的响应过程实质上就是中断的产生、使能到处理的过程。
& [/ C) [$ X: @* k6 [, ^: m* r  h, d! E- m' l
A. 错误6 b5 D! f2 A1 Z- E" }! M! h( @5 E
B. 正确  [- `1 c' }* ?
      满分:5  分* R1 g) t) @7 X$ ?7 }- X( \
7.  处理器还将集成的外设分成高速、中速和低速三组,这样可以方便的设置不同模块的工作频率,从而提高处理器的灵活性和可靠性。
) }$ \8 }+ F, B$ w0 K1 TA. 错误: h2 s: K% b# N& j/ a/ Z
B. 正确( N! P( @$ g' `
      满分:5  分6 m0 u6 P* Y% ]+ U/ V
8.  & e4 y( s) o5 S- h
在实际系统设计过程中,一般采用等于 3.3V 电压的外部单电源供电,然后经过系统内, `4 W+ f. T9 ^6 n. ~5 r
部转换后为系统提供各种需要的电压。1 {. }7 N+ z% X, C
A. 错误, c- y/ h+ b4 C6 o8 X
B. 正确
$ V9 K# O9 }0 X* g2 h7 ^. U      满分:5  分; D: x0 p# ]6 a: I: m
9.  # J: W: z5 H( i3 E; z2 p
锁相环是一种控制晶振使其相对于参考信号保持恒定相位的电路,在数字通信系统中使
4 A2 H3 y1 P* e* \& y用比较广泛。2 l+ c9 d5 i9 D2 v
A. 错误1 h4 G! H( @- v/ x( h1 i
B. 正确5 @+ r0 K6 h$ V/ w/ x& }" l4 k
      满分:5  分
1 ^( O$ J7 Q3 i1 J, M4 O10.  
" c1 T+ |# r' H/ Y, K外设时钟也包括两种:快速外设和慢速外设,分别通过HISPCP和LOSPCP两个寄存器进行设置。& D, r) x6 \' l5 J
A. 错误
6 x  ]2 X* u. p. x) XB. 正确
! }2 z) Y4 [: U. D9 t) `      满分:5  分 , b( k0 ?# z2 {6 U! \  X
1 ^- j7 N. n1 M1 e# ]2 t
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